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XC9572XL点击型号即可查看芯片规格书
特征
5 ns端到端逻辑延迟
系统频率高达178兆赫
72个宏单元，1600个可用门
提供小型封装
-44针PLCC（34个用户I/O引脚）
-44针VQFP（34个用户I/O引脚）
-48针CSP（38个用户I/O引脚）
-64针VQFP（52个用户I/O引脚）
-100针TQFP（72个用户I/O引脚）
为高性能3.3V系统优化
-低功率运行
-5V容限I/O引脚接受5V、3.3V和2.5V信号
-3.3V或2.5V输出能力
-先进的0.35微米特征尺寸CMOSFastFLASH技术先进的系统功能
-系统内可编程
-卓越的销锁定和可布线性FastConnect II8482;开关矩阵
-超宽54输入功能块
-每个宏单元最多90个产品术语个别产品条款分配
-三全局一局部时钟反转产品术语时钟
-每个输出引脚的单独输出启用
-所有用户和边界扫描管脚上的输入滞后输入
-所有用户引脚输入上的总线保持电路
-完整的IEEE标准1149.1边界扫描（JTAG）快速并发编程单个输出的回转率控制增强的数据安全功能卓越的质量和可靠性
-耐久性超过10000程序/擦除周期
-20年数据保留
-ESD保护超过2000V
插脚与44针PLCC封装和100针TQFP封装说明
XC9572XL是一款3.3V CPLD，主要用于高端通信和计算系统中的高性能、低电压应用。它由四部分组成54V18功能块，提供1600个可用门传播延迟5ns。
概述。
功率估计
cpld的功耗随系统频率、设计应用和输出的不同而有很大的变化。加载。为了减少功耗，每个宏单元在XC9500XL中，设备可以配置为低功耗模式（从默认的高性能模式）。此外，软件会自动停用未使用的产品术语和宏单元，以进一步节省电源。
对于ICC的一般估计，以下等式可以是
使用：
ICC（毫安）=MCHP（0.5）+MCLP（0.3）+MC（0.0045毫安/兆赫）
MCHP=高性能（默认）模式下的宏单元MCLP=低功耗模式下的宏单元MC=使用的宏单元总数F=时钟频率（MHz）该计算基于典型的运行条件在每个函数中使用16位上/下计数器的模式没有输出加载的块。实际ICC值变化与设计应用程序一起，并应在系统正常运行。
